mainboard: Add HP EliteBook 2560p
Most of the code is generated by autoport. The laptop works well under coreboot with SeaBIOS 1.13.0 payload, running Arch Linux with kernel 5.4.39 and 5.6.11. Change-Id: I126916e201fb8e4b9067f2dececebfb5bae6df73 Signed-off-by: Iru Cai <mytbk920423@gmail.com> Reviewed-on: https://review.coreboot.org/c/coreboot/+/41159 Tested-by: build bot (Jenkins) <no-reply@coreboot.org> Reviewed-by: Angel Pons <th3fanbus@gmail.com>
This commit is contained in:
Iru Cai
Patrick Georgi
@@ -20,6 +20,7 @@ config MAINBOARD_DIR
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config VARIANT_DIR
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string
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default "2560p" if BOARD_HP_2560P
|
||||
default "2570p" if BOARD_HP_2570P
|
||||
default "2760p" if BOARD_HP_2760P
|
||||
default "8460p" if BOARD_HP_8460P
|
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@@ -30,6 +31,7 @@ config VARIANT_DIR
|
||||
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||||
config MAINBOARD_PART_NUMBER
|
||||
string
|
||||
default "EliteBook 2560p" if BOARD_HP_2560P
|
||||
default "EliteBook 2570p" if BOARD_HP_2570P
|
||||
default "EliteBook 2760p" if BOARD_HP_2760P
|
||||
default "EliteBook 8460p" if BOARD_HP_8460P
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@@ -54,6 +56,7 @@ config VGA_BIOS_ID
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||||
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config USBDEBUG_HCD_INDEX
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||||
int
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||||
default 1 if BOARD_HP_2560P
|
||||
default 2 if BOARD_HP_2570P
|
||||
default 1 if BOARD_HP_2760P
|
||||
default 1 if BOARD_HP_8460P
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||||
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||||
@@ -1,5 +1,17 @@
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||||
## SPDX-License-Identifier: GPL-2.0-only
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config BOARD_HP_2560P
|
||||
bool "EliteBook 2560p"
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||||
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select BOARD_HP_SNB_IVB_LAPTOPS
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||||
select BOARD_ROMSIZE_KB_8192
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||||
select GFX_GMA_PANEL_1_ON_LVDS
|
||||
select INTEL_GMA_HAVE_VBT
|
||||
select INTEL_INT15
|
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select MAINBOARD_HAS_LIBGFXINIT
|
||||
select MAINBOARD_USES_IFD_GBE_REGION
|
||||
select SOUTHBRIDGE_INTEL_BD82X6X
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||||
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||||
config BOARD_HP_2570P
|
||||
bool "EliteBook 2570p"
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||||
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||||
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@@ -0,0 +1,7 @@
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||||
Category: laptop
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Board URL: https://support.hp.com/us-en/product/hp-elitebook-2560p-notebook-pc/5071201
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ROM protocol: SPI
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ROM package: SOIC-8
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ROM socketed: y
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Flashrom support: n
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||||
Release year: 2011
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BIN
src/mainboard/hp/snb_ivb_laptops/variants/2560p/data.vbt
Normal file
BIN
src/mainboard/hp/snb_ivb_laptops/variants/2560p/data.vbt
Normal file
Binary file not shown.
40
src/mainboard/hp/snb_ivb_laptops/variants/2560p/early_init.c
Normal file
40
src/mainboard/hp/snb_ivb_laptops/variants/2560p/early_init.c
Normal file
@@ -0,0 +1,40 @@
|
||||
/* SPDX-License-Identifier: GPL-2.0-or-later */
|
||||
|
||||
#include <bootblock_common.h>
|
||||
#include <northbridge/intel/sandybridge/raminit_native.h>
|
||||
#include <southbridge/intel/bd82x6x/pch.h>
|
||||
#include <ec/hp/kbc1126/ec.h>
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||||
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||||
const struct southbridge_usb_port mainboard_usb_ports[] = {
|
||||
{ 1, 1, 0 }, /* back bottom USB port, USB debug */
|
||||
{ 1, 1, 0 }, /* back upper USB port */
|
||||
{ 1, 1, 1 }, /* eSATA */
|
||||
{ 1, 1, 1 }, /* webcam */
|
||||
{ 1, 0, 2 },
|
||||
{ 1, 0, 2 }, /* bluetooth */
|
||||
{ 1, 0, 3 },
|
||||
{ 1, 0, 3 }, /* smartcard */
|
||||
{ 1, 1, 4 }, /* fingerprint reader */
|
||||
{ 1, 1, 4 }, /* WWAN */
|
||||
{ 0, 0, 5 },
|
||||
{ 1, 0, 5 }, /* docking */
|
||||
{ 0, 0, 6 },
|
||||
{ 0, 0, 6 },
|
||||
};
|
||||
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||||
void bootblock_mainboard_early_init(void)
|
||||
{
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||||
kbc1126_enter_conf();
|
||||
kbc1126_mailbox_init();
|
||||
kbc1126_kbc_init();
|
||||
kbc1126_ec_init();
|
||||
kbc1126_pm1_init();
|
||||
kbc1126_exit_conf();
|
||||
kbc1126_disable4e();
|
||||
}
|
||||
|
||||
void mainboard_get_spd(spd_raw_data *spd, bool id_only)
|
||||
{
|
||||
read_spd(&spd[0], 0x50, id_only);
|
||||
read_spd(&spd[2], 0x52, id_only);
|
||||
}
|
||||
@@ -0,0 +1,18 @@
|
||||
-- SPDX-License-Identifier: GPL-2.0-or-later
|
||||
|
||||
with HW.GFX.GMA;
|
||||
with HW.GFX.GMA.Display_Probing;
|
||||
|
||||
use HW.GFX.GMA;
|
||||
use HW.GFX.GMA.Display_Probing;
|
||||
|
||||
private package GMA.Mainboard is
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||||
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||||
ports : constant Port_List :=
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||||
(DP1, -- both on board and dock DP are DP1/HDMI1
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HDMI1,
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||||
Analog,
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||||
LVDS,
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||||
others => Disabled);
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||||
|
||||
end GMA.Mainboard;
|
||||
224
src/mainboard/hp/snb_ivb_laptops/variants/2560p/gpio.c
Normal file
224
src/mainboard/hp/snb_ivb_laptops/variants/2560p/gpio.c
Normal file
@@ -0,0 +1,224 @@
|
||||
/* SPDX-License-Identifier: GPL-2.0-or-later */
|
||||
|
||||
#include <southbridge/intel/common/gpio.h>
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_mode = {
|
||||
.gpio0 = GPIO_MODE_GPIO,
|
||||
.gpio1 = GPIO_MODE_GPIO,
|
||||
.gpio2 = GPIO_MODE_GPIO,
|
||||
.gpio3 = GPIO_MODE_GPIO,
|
||||
.gpio4 = GPIO_MODE_GPIO,
|
||||
.gpio5 = GPIO_MODE_NATIVE,
|
||||
.gpio6 = GPIO_MODE_GPIO,
|
||||
.gpio7 = GPIO_MODE_GPIO,
|
||||
.gpio8 = GPIO_MODE_GPIO,
|
||||
.gpio9 = GPIO_MODE_NATIVE,
|
||||
.gpio10 = GPIO_MODE_GPIO,
|
||||
.gpio11 = GPIO_MODE_GPIO,
|
||||
.gpio12 = GPIO_MODE_NATIVE,
|
||||
.gpio13 = GPIO_MODE_GPIO,
|
||||
.gpio14 = GPIO_MODE_GPIO,
|
||||
.gpio15 = GPIO_MODE_GPIO,
|
||||
.gpio16 = GPIO_MODE_GPIO,
|
||||
.gpio17 = GPIO_MODE_GPIO,
|
||||
.gpio18 = GPIO_MODE_GPIO,
|
||||
.gpio19 = GPIO_MODE_NATIVE,
|
||||
.gpio20 = GPIO_MODE_NATIVE,
|
||||
.gpio21 = GPIO_MODE_GPIO,
|
||||
.gpio22 = GPIO_MODE_GPIO,
|
||||
.gpio23 = GPIO_MODE_GPIO,
|
||||
.gpio24 = GPIO_MODE_GPIO,
|
||||
.gpio25 = GPIO_MODE_NATIVE,
|
||||
.gpio26 = GPIO_MODE_NATIVE,
|
||||
.gpio27 = GPIO_MODE_GPIO,
|
||||
.gpio28 = GPIO_MODE_GPIO,
|
||||
.gpio29 = GPIO_MODE_GPIO,
|
||||
.gpio30 = GPIO_MODE_NATIVE,
|
||||
.gpio31 = GPIO_MODE_NATIVE,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_direction = {
|
||||
.gpio0 = GPIO_DIR_OUTPUT,
|
||||
.gpio1 = GPIO_DIR_INPUT,
|
||||
.gpio2 = GPIO_DIR_INPUT,
|
||||
.gpio3 = GPIO_DIR_INPUT,
|
||||
.gpio4 = GPIO_DIR_INPUT,
|
||||
.gpio6 = GPIO_DIR_INPUT,
|
||||
.gpio7 = GPIO_DIR_INPUT,
|
||||
.gpio8 = GPIO_DIR_INPUT,
|
||||
.gpio10 = GPIO_DIR_INPUT,
|
||||
.gpio11 = GPIO_DIR_OUTPUT,
|
||||
.gpio13 = GPIO_DIR_INPUT,
|
||||
.gpio14 = GPIO_DIR_INPUT,
|
||||
.gpio15 = GPIO_DIR_INPUT,
|
||||
.gpio16 = GPIO_DIR_INPUT,
|
||||
.gpio17 = GPIO_DIR_OUTPUT,
|
||||
.gpio18 = GPIO_DIR_INPUT,
|
||||
.gpio21 = GPIO_DIR_INPUT,
|
||||
.gpio22 = GPIO_DIR_OUTPUT,
|
||||
.gpio23 = GPIO_DIR_INPUT,
|
||||
.gpio24 = GPIO_DIR_OUTPUT,
|
||||
.gpio27 = GPIO_DIR_OUTPUT,
|
||||
.gpio28 = GPIO_DIR_OUTPUT,
|
||||
.gpio29 = GPIO_DIR_OUTPUT,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_level = {
|
||||
.gpio0 = GPIO_LEVEL_LOW,
|
||||
.gpio11 = GPIO_LEVEL_LOW,
|
||||
.gpio17 = GPIO_LEVEL_HIGH,
|
||||
.gpio22 = GPIO_LEVEL_HIGH,
|
||||
.gpio24 = GPIO_LEVEL_HIGH,
|
||||
.gpio27 = GPIO_LEVEL_LOW,
|
||||
.gpio28 = GPIO_LEVEL_LOW,
|
||||
.gpio29 = GPIO_LEVEL_HIGH,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_reset = {
|
||||
.gpio24 = GPIO_RESET_RSMRST,
|
||||
.gpio30 = GPIO_RESET_RSMRST,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_invert = {
|
||||
.gpio1 = GPIO_INVERT,
|
||||
.gpio3 = GPIO_INVERT,
|
||||
.gpio6 = GPIO_INVERT,
|
||||
.gpio7 = GPIO_INVERT,
|
||||
.gpio10 = GPIO_INVERT,
|
||||
.gpio13 = GPIO_INVERT,
|
||||
.gpio14 = GPIO_INVERT,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set1 pch_gpio_set1_blink = {
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set2 pch_gpio_set2_mode = {
|
||||
.gpio32 = GPIO_MODE_NATIVE,
|
||||
.gpio33 = GPIO_MODE_GPIO,
|
||||
.gpio34 = GPIO_MODE_GPIO,
|
||||
.gpio35 = GPIO_MODE_GPIO,
|
||||
.gpio36 = GPIO_MODE_GPIO,
|
||||
.gpio37 = GPIO_MODE_GPIO,
|
||||
.gpio38 = GPIO_MODE_GPIO,
|
||||
.gpio39 = GPIO_MODE_GPIO,
|
||||
.gpio40 = GPIO_MODE_NATIVE,
|
||||
.gpio41 = GPIO_MODE_NATIVE,
|
||||
.gpio42 = GPIO_MODE_NATIVE,
|
||||
.gpio43 = GPIO_MODE_NATIVE,
|
||||
.gpio44 = GPIO_MODE_GPIO,
|
||||
.gpio45 = GPIO_MODE_NATIVE,
|
||||
.gpio46 = GPIO_MODE_NATIVE,
|
||||
.gpio47 = GPIO_MODE_NATIVE,
|
||||
.gpio48 = GPIO_MODE_GPIO,
|
||||
.gpio49 = GPIO_MODE_GPIO,
|
||||
.gpio50 = GPIO_MODE_GPIO,
|
||||
.gpio51 = GPIO_MODE_GPIO,
|
||||
.gpio52 = GPIO_MODE_GPIO,
|
||||
.gpio53 = GPIO_MODE_GPIO,
|
||||
.gpio54 = GPIO_MODE_GPIO,
|
||||
.gpio55 = GPIO_MODE_GPIO,
|
||||
.gpio56 = GPIO_MODE_NATIVE,
|
||||
.gpio57 = GPIO_MODE_GPIO,
|
||||
.gpio58 = GPIO_MODE_NATIVE,
|
||||
.gpio59 = GPIO_MODE_GPIO,
|
||||
.gpio60 = GPIO_MODE_GPIO,
|
||||
.gpio61 = GPIO_MODE_GPIO,
|
||||
.gpio62 = GPIO_MODE_NATIVE,
|
||||
.gpio63 = GPIO_MODE_NATIVE,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set2 pch_gpio_set2_direction = {
|
||||
.gpio33 = GPIO_DIR_OUTPUT,
|
||||
.gpio34 = GPIO_DIR_INPUT,
|
||||
.gpio35 = GPIO_DIR_OUTPUT,
|
||||
.gpio36 = GPIO_DIR_OUTPUT,
|
||||
.gpio37 = GPIO_DIR_OUTPUT,
|
||||
.gpio38 = GPIO_DIR_INPUT,
|
||||
.gpio39 = GPIO_DIR_INPUT,
|
||||
.gpio44 = GPIO_DIR_INPUT,
|
||||
.gpio48 = GPIO_DIR_INPUT,
|
||||
.gpio49 = GPIO_DIR_OUTPUT,
|
||||
.gpio50 = GPIO_DIR_INPUT,
|
||||
.gpio51 = GPIO_DIR_INPUT,
|
||||
.gpio52 = GPIO_DIR_INPUT,
|
||||
.gpio53 = GPIO_DIR_OUTPUT,
|
||||
.gpio54 = GPIO_DIR_INPUT,
|
||||
.gpio55 = GPIO_DIR_INPUT,
|
||||
.gpio57 = GPIO_DIR_OUTPUT,
|
||||
.gpio59 = GPIO_DIR_INPUT,
|
||||
.gpio60 = GPIO_DIR_OUTPUT,
|
||||
.gpio61 = GPIO_DIR_OUTPUT,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set2 pch_gpio_set2_level = {
|
||||
.gpio33 = GPIO_LEVEL_LOW,
|
||||
.gpio35 = GPIO_LEVEL_LOW,
|
||||
.gpio36 = GPIO_LEVEL_LOW,
|
||||
.gpio37 = GPIO_LEVEL_LOW,
|
||||
.gpio49 = GPIO_LEVEL_LOW,
|
||||
.gpio53 = GPIO_LEVEL_HIGH,
|
||||
.gpio57 = GPIO_LEVEL_HIGH,
|
||||
.gpio60 = GPIO_LEVEL_HIGH,
|
||||
.gpio61 = GPIO_LEVEL_HIGH,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set2 pch_gpio_set2_reset = {
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set3 pch_gpio_set3_mode = {
|
||||
.gpio64 = GPIO_MODE_NATIVE,
|
||||
.gpio65 = GPIO_MODE_NATIVE,
|
||||
.gpio66 = GPIO_MODE_NATIVE,
|
||||
.gpio67 = GPIO_MODE_NATIVE,
|
||||
.gpio68 = GPIO_MODE_GPIO,
|
||||
.gpio69 = GPIO_MODE_GPIO,
|
||||
.gpio70 = GPIO_MODE_GPIO,
|
||||
.gpio71 = GPIO_MODE_GPIO,
|
||||
.gpio72 = GPIO_MODE_GPIO,
|
||||
.gpio73 = GPIO_MODE_NATIVE,
|
||||
.gpio74 = GPIO_MODE_GPIO,
|
||||
.gpio75 = GPIO_MODE_NATIVE,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set3 pch_gpio_set3_direction = {
|
||||
.gpio68 = GPIO_DIR_OUTPUT,
|
||||
.gpio69 = GPIO_DIR_INPUT,
|
||||
.gpio70 = GPIO_DIR_OUTPUT,
|
||||
.gpio71 = GPIO_DIR_OUTPUT,
|
||||
.gpio72 = GPIO_DIR_OUTPUT,
|
||||
.gpio74 = GPIO_DIR_OUTPUT,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set3 pch_gpio_set3_level = {
|
||||
.gpio68 = GPIO_LEVEL_HIGH,
|
||||
.gpio70 = GPIO_LEVEL_HIGH,
|
||||
.gpio71 = GPIO_LEVEL_HIGH,
|
||||
.gpio72 = GPIO_LEVEL_LOW,
|
||||
.gpio74 = GPIO_LEVEL_HIGH,
|
||||
};
|
||||
|
||||
static const struct pch_gpio_set3 pch_gpio_set3_reset = {
|
||||
};
|
||||
|
||||
const struct pch_gpio_map mainboard_gpio_map = {
|
||||
.set1 = {
|
||||
.mode = &pch_gpio_set1_mode,
|
||||
.direction = &pch_gpio_set1_direction,
|
||||
.level = &pch_gpio_set1_level,
|
||||
.blink = &pch_gpio_set1_blink,
|
||||
.invert = &pch_gpio_set1_invert,
|
||||
.reset = &pch_gpio_set1_reset,
|
||||
},
|
||||
.set2 = {
|
||||
.mode = &pch_gpio_set2_mode,
|
||||
.direction = &pch_gpio_set2_direction,
|
||||
.level = &pch_gpio_set2_level,
|
||||
.reset = &pch_gpio_set2_reset,
|
||||
},
|
||||
.set3 = {
|
||||
.mode = &pch_gpio_set3_mode,
|
||||
.direction = &pch_gpio_set3_direction,
|
||||
.level = &pch_gpio_set3_level,
|
||||
.reset = &pch_gpio_set3_reset,
|
||||
},
|
||||
};
|
||||
38
src/mainboard/hp/snb_ivb_laptops/variants/2560p/hda_verb.c
Normal file
38
src/mainboard/hp/snb_ivb_laptops/variants/2560p/hda_verb.c
Normal file
@@ -0,0 +1,38 @@
|
||||
/* SPDX-License-Identifier: GPL-2.0-or-later */
|
||||
|
||||
#include <device/azalia_device.h>
|
||||
|
||||
const u32 cim_verb_data[] = {
|
||||
0x111d7605, /* Codec Vendor / Device ID: IDT */
|
||||
0x103c162b, /* Subsystem ID */
|
||||
11, /* Number of 4 dword sets */
|
||||
AZALIA_SUBVENDOR(0, 0x103c162b),
|
||||
AZALIA_PIN_CFG(0, 0x0a, 0x40f000f0),
|
||||
AZALIA_PIN_CFG(0, 0x0b, 0x0421401f),
|
||||
AZALIA_PIN_CFG(0, 0x0c, 0x04a11020),
|
||||
AZALIA_PIN_CFG(0, 0x0d, 0x90170110),
|
||||
AZALIA_PIN_CFG(0, 0x0e, 0x40f000f0),
|
||||
AZALIA_PIN_CFG(0, 0x0f, 0x40f000f0),
|
||||
AZALIA_PIN_CFG(0, 0x10, 0x40f000f0),
|
||||
AZALIA_PIN_CFG(0, 0x11, 0x90a60130),
|
||||
AZALIA_PIN_CFG(0, 0x1f, 0x40f000f0),
|
||||
AZALIA_PIN_CFG(0, 0x20, 0x40f000f0),
|
||||
|
||||
0x11c11040, /* Codec Vendor / Device ID: LSI */
|
||||
0x103c3066, /* Subsystem ID */
|
||||
1, /* Number of 4 dword sets */
|
||||
AZALIA_SUBVENDOR(1, 0x103c3066),
|
||||
|
||||
0x80862805, /* Codec Vendor / Device ID: Intel */
|
||||
0x80860101, /* Subsystem ID */
|
||||
4, /* Number of 4 dword sets */
|
||||
AZALIA_SUBVENDOR(3, 0x80860101),
|
||||
AZALIA_PIN_CFG(3, 0x05, 0x18560010),
|
||||
AZALIA_PIN_CFG(3, 0x06, 0x58560020),
|
||||
AZALIA_PIN_CFG(3, 0x07, 0x18560030),
|
||||
|
||||
};
|
||||
|
||||
const u32 pc_beep_verbs[0] = {};
|
||||
|
||||
AZALIA_ARRAY_SIZES;
|
||||
@@ -0,0 +1,52 @@
|
||||
# SPDX-License-Identifier: GPL-2.0-or-later
|
||||
|
||||
chip northbridge/intel/sandybridge
|
||||
register "gpu_cpu_backlight" = "0x00000155"
|
||||
register "gpu_pch_backlight" = "0x02880288"
|
||||
|
||||
device domain 0 on
|
||||
subsystemid 0x103c 0x162b inherit
|
||||
|
||||
device pci 01.0 off end # PEG
|
||||
device pci 02.0 on end # iGPU
|
||||
|
||||
chip southbridge/intel/bd82x6x # Intel Series 6 Cougar Point PCH
|
||||
# mailbox at 0x200/0x201 and PM1 at 0x220
|
||||
register "gen1_dec" = "0x007c0201"
|
||||
register "gen2_dec" = "0x000c0101"
|
||||
register "gen3_dec" = "0x00fcfe01"
|
||||
register "gen4_dec" = "0x000402e9"
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register "gpi6_routing" = "2"
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register "pcie_hotplug_map" = "{ 0, 1, 0, 0, 0, 0, 0, 0 }"
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# HDD(0), ODD(1), eSATA(4), dock eSATA(5)
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register "sata_port_map" = "0x33"
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device pci 1c.0 off end # PCIe Port #1
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device pci 1c.1 on # PCIe Port #2, ExpressCard
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smbios_slot_desc "SlotTypePcmcia" "SlotLengthShort"
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"ExpressCard Slot" "SlotDataBusWidth1X"
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end
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device pci 1c.2 on end # PCIe Port #3, SD/MMC Host Controller
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device pci 1c.3 on # PCIe Port #4, WLAN
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smbios_slot_desc "SlotTypePciExpressMini52pinWithoutBSKO"
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"SlotLengthShort" "Mini PCIe" "SlotDataBusWidth1X"
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end
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device pci 1c.4 off end # PCIe Port #5
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device pci 1c.5 off end # PCIe Port #6
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device pci 1c.6 on # PCIe Port #7, WWAN
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smbios_slot_desc "SlotTypePciExpressMini52pinWithoutBSKO"
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"SlotLengthLong" "Mini PCIe" "SlotDataBusWidth1X"
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end
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device pci 1c.7 off end # PCIe Port #8
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device pci 1f.0 on # LPC bridge
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chip ec/hp/kbc1126
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register "ec_data_port" = "0x60"
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register "ec_cmd_port" = "0x64"
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register "ec_ctrl_reg" = "0xca"
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register "ec_fan_ctrl_value" = "0x6b"
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device pnp ff.1 off end
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end
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end
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end
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end
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end
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