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Add RPP-S PCI root port definitions

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Change-Id: I6ec9757b0402299be9c96fc0019890068f2f5e43
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Jeremy Soller
2023-02-10 11:59:51 -07:00
parent 7c0aa8288c
commit 7ab6edb20e
2 changed files with 57 additions and 0 deletions
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29
src/include/device/pci_ids.h
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@ -3462,6 +3462,35 @@
#define PCI_DID_INTEL_RPL_P_PCIE_RP2 0xa70d #define PCI_DID_INTEL_RPL_P_PCIE_RP2 0xa70d
#define PCI_DID_INTEL_RPL_P_PCIE_RP3 0xa72d #define PCI_DID_INTEL_RPL_P_PCIE_RP3 0xa72d
#define PCI_DID_INTEL_RPP_S_PCIE_RP1 0x7a38
#define PCI_DID_INTEL_RPP_S_PCIE_RP2 0x7a39
#define PCI_DID_INTEL_RPP_S_PCIE_RP3 0x7a3a
#define PCI_DID_INTEL_RPP_S_PCIE_RP4 0x7a3b
#define PCI_DID_INTEL_RPP_S_PCIE_RP5 0x7a3c
#define PCI_DID_INTEL_RPP_S_PCIE_RP6 0x7a3d
#define PCI_DID_INTEL_RPP_S_PCIE_RP7 0x7a3e
#define PCI_DID_INTEL_RPP_S_PCIE_RP8 0x7a3f
#define PCI_DID_INTEL_RPP_S_PCIE_RP9 0x7a30
#define PCI_DID_INTEL_RPP_S_PCIE_RP10 0x7a31
#define PCI_DID_INTEL_RPP_S_PCIE_RP11 0x7a32
#define PCI_DID_INTEL_RPP_S_PCIE_RP12 0x7a33
#define PCI_DID_INTEL_RPP_S_PCIE_RP13 0x7a34
#define PCI_DID_INTEL_RPP_S_PCIE_RP14 0x7a35
#define PCI_DID_INTEL_RPP_S_PCIE_RP15 0x7a36
#define PCI_DID_INTEL_RPP_S_PCIE_RP16 0x7a37
#define PCI_DID_INTEL_RPP_S_PCIE_RP17 0x7a40
#define PCI_DID_INTEL_RPP_S_PCIE_RP18 0x7a41
#define PCI_DID_INTEL_RPP_S_PCIE_RP19 0x7a42
#define PCI_DID_INTEL_RPP_S_PCIE_RP20 0x7a43
#define PCI_DID_INTEL_RPP_S_PCIE_RP21 0x7a44
#define PCI_DID_INTEL_RPP_S_PCIE_RP22 0x7a45
#define PCI_DID_INTEL_RPP_S_PCIE_RP23 0x7a46
#define PCI_DID_INTEL_RPP_S_PCIE_RP24 0x7a47
#define PCI_DID_INTEL_RPP_S_PCIE_RP25 0x7a48
#define PCI_DID_INTEL_RPP_S_PCIE_RP26 0x7a49
#define PCI_DID_INTEL_RPP_S_PCIE_RP27 0x7a4a
#define PCI_DID_INTEL_RPP_S_PCIE_RP28 0x7a4b
/* Intel SATA device Ids */ /* Intel SATA device Ids */
#define PCI_DID_INTEL_LPT_H_DESKTOP_SATA_IDE 0x8c00 #define PCI_DID_INTEL_LPT_H_DESKTOP_SATA_IDE 0x8c00
#define PCI_DID_INTEL_LPT_H_DESKTOP_SATA_AHCI 0x8c02 #define PCI_DID_INTEL_LPT_H_DESKTOP_SATA_AHCI 0x8c02

28
src/soc/intel/common/block/pcie/pcie.c
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@ -329,6 +329,34 @@ static const unsigned short pcie_device_ids[] = {
PCI_DID_INTEL_ADP_M_N_PCIE_RP10, PCI_DID_INTEL_ADP_M_N_PCIE_RP10,
PCI_DID_INTEL_ADP_N_PCIE_RP11, PCI_DID_INTEL_ADP_N_PCIE_RP11,
PCI_DID_INTEL_ADP_N_PCIE_RP12, PCI_DID_INTEL_ADP_N_PCIE_RP12,
PCI_DID_INTEL_RPP_S_PCIE_RP1,
PCI_DID_INTEL_RPP_S_PCIE_RP2,
PCI_DID_INTEL_RPP_S_PCIE_RP3,
PCI_DID_INTEL_RPP_S_PCIE_RP4,
PCI_DID_INTEL_RPP_S_PCIE_RP5,
PCI_DID_INTEL_RPP_S_PCIE_RP6,
PCI_DID_INTEL_RPP_S_PCIE_RP7,
PCI_DID_INTEL_RPP_S_PCIE_RP8,
PCI_DID_INTEL_RPP_S_PCIE_RP9,
PCI_DID_INTEL_RPP_S_PCIE_RP10,
PCI_DID_INTEL_RPP_S_PCIE_RP11,
PCI_DID_INTEL_RPP_S_PCIE_RP12,
PCI_DID_INTEL_RPP_S_PCIE_RP13,
PCI_DID_INTEL_RPP_S_PCIE_RP14,
PCI_DID_INTEL_RPP_S_PCIE_RP15,
PCI_DID_INTEL_RPP_S_PCIE_RP16,
PCI_DID_INTEL_RPP_S_PCIE_RP17,
PCI_DID_INTEL_RPP_S_PCIE_RP18,
PCI_DID_INTEL_RPP_S_PCIE_RP19,
PCI_DID_INTEL_RPP_S_PCIE_RP20,
PCI_DID_INTEL_RPP_S_PCIE_RP21,
PCI_DID_INTEL_RPP_S_PCIE_RP22,
PCI_DID_INTEL_RPP_S_PCIE_RP23,
PCI_DID_INTEL_RPP_S_PCIE_RP24,
PCI_DID_INTEL_RPP_S_PCIE_RP25,
PCI_DID_INTEL_RPP_S_PCIE_RP26,
PCI_DID_INTEL_RPP_S_PCIE_RP27,
PCI_DID_INTEL_RPP_S_PCIE_RP28,
0 0
}; };